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LFEC15E-5FN484C FPGA - 프로그램가능 게이트 필드는 15.4K 루트스 Pb-프리를 배치합니다
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LFEC15E-5FN484C FPGA - 프로그램가능 게이트 필드는 15.4K 루트스 Pb-프리를 배치합니다

원래 장소 전화
브랜드 이름 Lattice Semiconductor
인증 ROHS
모델 번호 LFEC15E-5FN484C
제품 세부 정보
상품 이름:
LFEC15E-5FN484C
상태:
원형 100%
설치 메소드페:
IC FPGA 352 입출력
패키지:
484FPBGA
전압 - 공급:
국제 기준
맥스. 역류:
국제 기준
애플리케이션:
FPGA(필드 프로그래밍 가능 게이트 어레이)
제품 설명

                                                                  LFEC15E-5FN484C FPGA - 프로그램가능 게이트 필드는 15.4K 루트스 Pb-프리를 배치합니다 0LFEC15E-5FN484C 데이터 시트
제품 상세정보

도입

FPGA 기기의 LatticeECP/EC 가정은 저비용으로 주류 FPGA 기능을 전달하기 위해 최적화됩니다. 최대 성능과 가치를 위해, 라티스텍피티엠 (경제 플러스) FPGA 개념은 효율적 FPGA 구성을 고속 전용 기능과 결합합니다. 온칩으로 헌신적 고성능 DSP 블록을 제공하면서, 이 접근법을 구현하기 위한 레티스의 대통령의 가족은 라티스텍피드스피티엠 (DSP 외에 경제) 가족입니다. 라티스텍티엠 (EConomy) 가정이 더 낮은 비용 솔루션을 달성하기 위해 헌신적 기능 블럭 없는 라티스텍피 기기의 모든 다용도의 기능을 지원합니다.

특징

■ 광범위한 비중과 패키지 옵션
32.8K LUT4s에 대한 오우 1.5K
오우 65 내지 496 I/Os
지원받은 오우 비중 이동
■ 시스드스피티엠은 (라티스텍피티엠 버전을) 차단합니다
오우 고성능은 증가하고, 축적됩니다
오우 4 내지 8 블록
- 4 내지 8 36x36 곱셈 장치 또는
- 16 내지 32 18x18 곱셈 장치 또는
- 32 내지 64 9x9 곱셈 장치
■는 메모리를 끼워 넣었고 분배했습니다
498 kbit 시스멤티엠 내장된 블럭 램 (EBR)에 대한 오우 18 kbit
131 kbit에 달하는 오우는 RAM을 분배했습니다
오우 탄력적 메모리 자원 :
- 분포되고 블록 메모리
■ 탄력적 입출력 버퍼
오우 프로그램 가능한 sysI/OTM 버퍼는 인터페이스의 넓은 범위를 지원합니다 :
- LVCMOS 3.3/2.5/1.8/1.5/1.2
- LVTTL
- SSTL 3/2 등급 I, II, SSTL18 등급 I
- HSTL 18 등급 I, II, 3세, HSTL15 등급 I, 3세
- PCI
- LVDS, 버스-LVDS, LVPECL, RSDS
■는 DDR 메모리 지원을 제공했습니다
DDR400 (200MHz)에 달하는 오우 도구 인터페이스
■ 시스클록티엠 피볼스
장치 당 네 아날로그 PLL에 달하는 오우
오우 시계는 이동을 증가시키고 나누고 단계적으로 시행합니다
■ 시스템 레벨 지원
이스프트레이시티엠 내부 논리 분석기 역량 외에, 오우 IEEE 표준 1149.1 바운더리 스캔
오우 SPI 기동 플래시 인터페이스
오우 1.2V 전원 공급기
■ 저비용 FPGA
주류 애플리케이션에 대해 최적화된 오우 특징
오우 저비용 TQFP와 PQFP 패키징

상술

       
특성 속성 값
제조사 레티스 세미컨덕터
상품 카테고리 FPGA는 (프로그램식 게이트배열을 처리합니다)
시리즈 ECP2M
포장 케이스 484-bbga
작동 온도 0' C ~ 85' C (TJ)
설치형 표면 부착
전압 공급1.14 V ~ 1.26 V
공급 툴 장치 패키지 484-fpbga (23x23)
게이트의 IC 수 
I 오우의 수 303 입출력
랩스 -클브스의 수 4250
논리 원소 휴대폰의 번호34000
전체 램 비트2151424개 비트

기술

IC FPGA 352 입출력 484FBGA
FPGA 라티스텍 가족 15400 세포 420MHz 130nm 기술 1.2V 484-핀 에프비지에이


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